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17 KiB
ArmAsm
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ArmAsm
# NOTE: Assertions have been autogenerated by utils/update_mca_test_checks.py
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# RUN: llvm-mca -mtriple=thumbv8.1-m.main-none-none-eabi -mcpu=cortex-m55 -instruction-tables < %s | FileCheck %s
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vldrb.8 q1, [r0, 0]
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vldrb.8 q1, [r0, 0]!
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vldrb.8 q1, [r0], 0
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vldrh.16 q1, [r0, 0]
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vldrh.16 q1, [r0, 0]!
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vldrh.16 q1, [r0], 0
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vldrw.32 q1, [r0, 0]
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vldrw.32 q1, [r0, 0]!
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vldrb.u16 q1, [r0, 0]
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vldrb.u16 q1, [r0, 0]!
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vldrb.u16 q1, [r0], 0
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vldrb.u32 q1, [r0, 0]
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vldrb.u32 q1, [r0, 0]!
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vldrb.u32 q1, [r0], 0
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vldrh.u32 q1, [r0, 0]
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vldrh.u32 q1, [r0, 0]!
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vldrh.u32 q1, [r0], 0
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vldrb.s16 q1, [r0, 4]
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vldrb.s16 q1, [r0, 4]!
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vldrb.s16 q1, [r0], 4
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vldrb.s32 q1, [r0, 4]
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vldrb.s32 q1, [r0, 4]!
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vldrb.s32 q1, [r0], 4
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vldrh.s32 q1, [r0, 4]
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vldrh.s32 q1, [r0, 4]!
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vldrh.s32 q1, [r0], 4
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vldrw.32 q1, [r0, q0]
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vldrh.16 q1, [r0, q0]
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vldrb.8 q1, [r0, q0]
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vldrb.u16 q1, [r0, q0]
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vldrb.u32 q1, [r0, q0]
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vldrh.u32 q1, [r0, q0]
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vldrb.s16 q1, [r0, q0]
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vldrb.s32 q1, [r0, q0]
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vldrh.s32 q1, [r0, q0]
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vldrw.32 q1, [r0, q0, uxtw #2]
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vldrh.16 q1, [r0, q0, uxtw #1]
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vldrh.u32 q1, [r0, q0, uxtw #1]
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vldrh.s32 q1, [r0, q0, uxtw #1]
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vldrw.32 q1, [q0, 4]
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vldrw.32 q1, [q0, 4]!
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vld20.8 {q0, q1}, [r0]
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vld21.8 {q0, q1}, [r0]!
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vld40.8 {q0, q1, q2, q3}, [r0]
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vld43.8 {q0, q1, q2, q3}, [r0]!
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vld20.16 {q0, q1}, [r0]
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vld21.16 {q0, q1}, [r0]!
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vld40.16 {q0, q1, q2, q3}, [r0]
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vld43.16 {q0, q1, q2, q3}, [r0]!
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vld20.32 {q0, q1}, [r0]
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vld21.32 {q0, q1}, [r0]!
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vld40.32 {q0, q1, q2, q3}, [r0]
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vld43.32 {q0, q1, q2, q3}, [r0]!
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vstrb.8 q1, [r0, 0]
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|
vstrb.8 q1, [r0, 0]!
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|
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vstrh.16 q1, [r0, 0]!
|
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|
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vstrw.32 q1, [r0, 0]!
|
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vstrb.16 q1, [r0, 0]
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vstrb.16 q1, [r0, 0]!
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vstrb.32 q1, [r0, 0]!
|
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vstrh.32 q1, [r0, 0]!
|
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vstrw.32 q1, [r0, q0]
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vstrh.16 q1, [r0, q0]
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vstrb.8 q1, [r0, q0]
|
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vstrb.16 q1, [r0, q0]
|
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vstrb.32 q1, [r0, q0]
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vstrh.32 q1, [r0, q0]
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vstrw.32 q1, [r0, q0, uxtw #2]
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vstrh.16 q1, [r0, q0, uxtw #1]
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vstrh.32 q1, [r0, q0, uxtw #1]
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vstrw.32 q1, [q0, 4]
|
|
vstrw.32 q1, [q0, 4]!
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vst20.8 {q0, q1}, [r0]
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|
vst21.8 {q0, q1}, [r0]!
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vst40.8 {q0, q1, q2, q3}, [r0]
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|
vst43.8 {q0, q1, q2, q3}, [r0]!
|
|
vst20.16 {q0, q1}, [r0]
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|
vst21.16 {q0, q1}, [r0]!
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|
vst40.16 {q0, q1, q2, q3}, [r0]
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|
vst43.16 {q0, q1, q2, q3}, [r0]!
|
|
vst20.32 {q0, q1}, [r0]
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|
vst21.32 {q0, q1}, [r0]!
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|
vst40.32 {q0, q1, q2, q3}, [r0]
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vst43.32 {q0, q1, q2, q3}, [r0]!
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# CHECK: Instruction Info:
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# CHECK-NEXT: [1]: #uOps
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# CHECK-NEXT: [2]: Latency
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# CHECK-NEXT: [3]: RThroughput
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# CHECK-NEXT: [4]: MayLoad
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# CHECK-NEXT: [5]: MayStore
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# CHECK-NEXT: [6]: HasSideEffects (U)
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# CHECK: [1] [2] [3] [4] [5] [6] Instructions:
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# CHECK-NEXT: 1 1 2.00 * vldrb.u8 q1, [r0]
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# CHECK-NEXT: 1 1 2.00 * vldrb.u8 q1, [r0, #0]!
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# CHECK-NEXT: 1 1 2.00 * vldrb.u8 q1, [r0], #0
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# CHECK-NEXT: 1 1 2.00 * vldrh.u16 q1, [r0]
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# CHECK-NEXT: 1 1 2.00 * vldrh.u16 q1, [r0, #0]!
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# CHECK-NEXT: 1 1 2.00 * vldrh.u16 q1, [r0], #0
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# CHECK-NEXT: 1 1 2.00 * vldrw.u32 q1, [r0]
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# CHECK-NEXT: 1 1 2.00 * vldrw.u32 q1, [r0, #0]!
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# CHECK-NEXT: 1 1 2.00 * vldrw.u32 q1, [r0], #0
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# CHECK-NEXT: 1 1 2.00 * vldrb.u16 q1, [r0]
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# CHECK-NEXT: 1 1 2.00 * vldrb.u16 q1, [r0]!
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# CHECK-NEXT: 1 1 2.00 * vldrb.u16 q1, [r0], #0
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# CHECK-NEXT: 1 1 2.00 * vldrb.u32 q1, [r0]
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# CHECK-NEXT: 1 1 2.00 * vldrb.u32 q1, [r0]!
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# CHECK-NEXT: 1 1 2.00 * vldrb.u32 q1, [r0], #0
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|
# CHECK-NEXT: 1 1 2.00 * vldrh.u32 q1, [r0]
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|
# CHECK-NEXT: 1 1 2.00 * vldrh.u32 q1, [r0]!
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|
# CHECK-NEXT: 1 1 2.00 * vldrh.u32 q1, [r0], #0
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|
# CHECK-NEXT: 1 1 2.00 * vldrb.s16 q1, [r0, #4]
|
|
# CHECK-NEXT: 1 1 2.00 * vldrb.s16 q1, [r0, #4]!
|
|
# CHECK-NEXT: 1 1 2.00 * vldrb.s16 q1, [r0], #4
|
|
# CHECK-NEXT: 1 1 2.00 * vldrb.s32 q1, [r0, #4]
|
|
# CHECK-NEXT: 1 1 2.00 * vldrb.s32 q1, [r0, #4]!
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|
# CHECK-NEXT: 1 1 2.00 * vldrb.s32 q1, [r0], #4
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|
# CHECK-NEXT: 1 1 2.00 * vldrh.s32 q1, [r0, #4]
|
|
# CHECK-NEXT: 1 1 2.00 * vldrh.s32 q1, [r0, #4]!
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|
# CHECK-NEXT: 1 1 2.00 * vldrh.s32 q1, [r0], #4
|
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# CHECK-NEXT: 1 6 2.00 * vldrw.u32 q1, [r0, q0]
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# CHECK-NEXT: 1 6 2.00 * vldrh.u16 q1, [r0, q0]
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# CHECK-NEXT: 1 6 2.00 * vldrb.u8 q1, [r0, q0]
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# CHECK-NEXT: 1 6 2.00 * vldrb.u16 q1, [r0, q0]
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# CHECK-NEXT: 1 6 2.00 * vldrb.u32 q1, [r0, q0]
|
|
# CHECK-NEXT: 1 6 2.00 * vldrh.u32 q1, [r0, q0]
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# CHECK-NEXT: 1 6 2.00 * vldrb.s16 q1, [r0, q0]
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|
# CHECK-NEXT: 1 6 2.00 * vldrb.s32 q1, [r0, q0]
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# CHECK-NEXT: 1 6 2.00 * vldrh.s32 q1, [r0, q0]
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# CHECK-NEXT: 1 6 2.00 * vldrw.u32 q1, [r0, q0, uxtw #2]
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# CHECK-NEXT: 1 6 2.00 * vldrh.u16 q1, [r0, q0, uxtw #1]
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# CHECK-NEXT: 1 6 2.00 * vldrh.u32 q1, [r0, q0, uxtw #1]
|
|
# CHECK-NEXT: 1 6 2.00 * vldrh.s32 q1, [r0, q0, uxtw #1]
|
|
# CHECK-NEXT: 1 6 2.00 * vldrw.u32 q1, [q0, #4]
|
|
# CHECK-NEXT: 1 6 2.00 * vldrw.u32 q1, [q0, #4]!
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|
# CHECK-NEXT: 1 1 2.00 * vld20.8 {q0, q1}, [r0]
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# CHECK-NEXT: 1 1 2.00 * vld21.8 {q0, q1}, [r0]!
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# CHECK-NEXT: 1 1 2.00 * vld40.8 {q0, q1, q2, q3}, [r0]
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|
# CHECK-NEXT: 1 1 2.00 * vld43.8 {q0, q1, q2, q3}, [r0]!
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|
# CHECK-NEXT: 1 1 2.00 * vld20.16 {q0, q1}, [r0]
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# CHECK-NEXT: 1 1 2.00 * vld21.16 {q0, q1}, [r0]!
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|
# CHECK-NEXT: 1 1 2.00 * vld40.16 {q0, q1, q2, q3}, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vld43.16 {q0, q1, q2, q3}, [r0]!
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|
# CHECK-NEXT: 1 1 2.00 * vld20.32 {q0, q1}, [r0]
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# CHECK-NEXT: 1 1 2.00 * vld21.32 {q0, q1}, [r0]!
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# CHECK-NEXT: 1 1 2.00 * vld40.32 {q0, q1, q2, q3}, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vld43.32 {q0, q1, q2, q3}, [r0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vstrb.8 q1, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vstrb.8 q1, [r0, #0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vstrb.8 q1, [r0], #0
|
|
# CHECK-NEXT: 1 1 2.00 * vstrh.16 q1, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vstrh.16 q1, [r0, #0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vstrh.16 q1, [r0], #0
|
|
# CHECK-NEXT: 1 1 2.00 * vstrw.32 q1, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vstrw.32 q1, [r0, #0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vstrw.32 q1, [r0], #0
|
|
# CHECK-NEXT: 1 1 2.00 * vstrb.16 q1, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vstrb.16 q1, [r0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vstrb.16 q1, [r0], #0
|
|
# CHECK-NEXT: 1 1 2.00 * vstrb.32 q1, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vstrb.32 q1, [r0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vstrb.32 q1, [r0], #0
|
|
# CHECK-NEXT: 1 1 2.00 * vstrh.32 q1, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vstrh.32 q1, [r0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vstrh.32 q1, [r0], #0
|
|
# CHECK-NEXT: 1 5 2.00 * vstrw.32 q1, [r0, q0]
|
|
# CHECK-NEXT: 1 5 2.00 * vstrh.16 q1, [r0, q0]
|
|
# CHECK-NEXT: 1 5 2.00 * vstrb.8 q1, [r0, q0]
|
|
# CHECK-NEXT: 1 5 2.00 * vstrb.16 q1, [r0, q0]
|
|
# CHECK-NEXT: 1 5 2.00 * vstrb.32 q1, [r0, q0]
|
|
# CHECK-NEXT: 1 5 2.00 * vstrh.32 q1, [r0, q0]
|
|
# CHECK-NEXT: 1 5 2.00 * vstrw.32 q1, [r0, q0, uxtw #2]
|
|
# CHECK-NEXT: 1 5 2.00 * vstrh.16 q1, [r0, q0, uxtw #1]
|
|
# CHECK-NEXT: 1 5 2.00 * vstrh.32 q1, [r0, q0, uxtw #1]
|
|
# CHECK-NEXT: 1 5 2.00 * vstrw.32 q1, [q0, #4]
|
|
# CHECK-NEXT: 1 5 2.00 * vstrw.32 q1, [q0, #4]!
|
|
# CHECK-NEXT: 1 1 2.00 * vst20.8 {q0, q1}, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vst21.8 {q0, q1}, [r0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vst40.8 {q0, q1, q2, q3}, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vst43.8 {q0, q1, q2, q3}, [r0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vst20.16 {q0, q1}, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vst21.16 {q0, q1}, [r0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vst40.16 {q0, q1, q2, q3}, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vst43.16 {q0, q1, q2, q3}, [r0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vst20.32 {q0, q1}, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vst21.32 {q0, q1}, [r0]!
|
|
# CHECK-NEXT: 1 1 2.00 * vst40.32 {q0, q1, q2, q3}, [r0]
|
|
# CHECK-NEXT: 1 1 2.00 * vst43.32 {q0, q1, q2, q3}, [r0]!
|
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# CHECK: Resources:
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# CHECK-NEXT: [0] - M55UnitALU
|
|
# CHECK-NEXT: [1] - M55UnitLoadStore
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|
# CHECK-NEXT: [2] - M55UnitVecALU
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|
# CHECK-NEXT: [3] - M55UnitVecFPALU
|
|
# CHECK-NEXT: [4] - M55UnitVecSys
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|
# CHECK: Resource pressure per iteration:
|
|
# CHECK-NEXT: [0] [1] [2] [3] [4]
|
|
# CHECK-NEXT: - 190.00 - - -
|
|
|
|
# CHECK: Resource pressure by instruction:
|
|
# CHECK-NEXT: [0] [1] [2] [3] [4] Instructions:
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# CHECK-NEXT: - 2.00 - - - vldrb.u8 q1, [r0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u8 q1, [r0, #0]!
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u8 q1, [r0], #0
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.u16 q1, [r0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.u16 q1, [r0, #0]!
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.u16 q1, [r0], #0
|
|
# CHECK-NEXT: - 2.00 - - - vldrw.u32 q1, [r0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrw.u32 q1, [r0, #0]!
|
|
# CHECK-NEXT: - 2.00 - - - vldrw.u32 q1, [r0], #0
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u16 q1, [r0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u16 q1, [r0]!
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u16 q1, [r0], #0
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u32 q1, [r0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u32 q1, [r0]!
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u32 q1, [r0], #0
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.u32 q1, [r0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.u32 q1, [r0]!
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.u32 q1, [r0], #0
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.s16 q1, [r0, #4]
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.s16 q1, [r0, #4]!
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.s16 q1, [r0], #4
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.s32 q1, [r0, #4]
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.s32 q1, [r0, #4]!
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.s32 q1, [r0], #4
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.s32 q1, [r0, #4]
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.s32 q1, [r0, #4]!
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.s32 q1, [r0], #4
|
|
# CHECK-NEXT: - 2.00 - - - vldrw.u32 q1, [r0, q0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.u16 q1, [r0, q0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u8 q1, [r0, q0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u16 q1, [r0, q0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.u32 q1, [r0, q0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrh.u32 q1, [r0, q0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.s16 q1, [r0, q0]
|
|
# CHECK-NEXT: - 2.00 - - - vldrb.s32 q1, [r0, q0]
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